Подскажите можно ли подать частоту с ядра FPGA, без внешнего генератора? Просмотрел UG382, английским не сильно владею, но как понял там PLL тактируется от внешнего сигнала. Учусь писать на Verilog, подскажите где покапать описание и примеры работы с PLL на Verilog для данной ситуации.