Есть большая проблема с определением причины очень странного глюка:
В кристалл Xilinx зашиваем проект и он нормально работает, но от 7 до 10 часов а потом одна его часть зависает.

Теперь подробней: Путем долгих экспериментов выяснилось что зависает триггер причем внутри корки Xilinx (т.е. выходного сигнала перестает быть):
start_flag <= (((EQUAL(rxd_sync(63 downto 56), SFD))
and (not rxc_sync(7)))
or preserve_preamble) and start_code_found and enable;
Сигнал start_flag перестает работать. При этом подача Reset на данный блок и соответственно на триггер который образуется данным условием не приводит к выводу системы из этого "зависшего" состояния.
Причем даже после того как случилось это странное зависание можно с помощью чипскопа лицезреть наличие всех правильных сигналов которые присутствуют в условии.

Проверялось:
1. Качественность раскладки сигнала в FPGAEditor
2. Констрейны
3. Питание ядра
4. Наличие reset и их синхронность для всех сигналов(reset заходит на ВСЕ сигналы-это отдельно проверено)
5. Глюк не связан с работой близ лежащей техники так как проявляется на платах расположенных в других отделах фирмы.
6. Без куллера кристалл нагревается до 71 градуса, но специально нагревал больше - вызвать глюк быстрее 6-и часов не смог

Большущая просьба генерировать по больше разных версий из-за чего такое может быть!