EPF10K50SQC240, как на verilog работать с внутренней RAM Опции

[addi II]

Приветствую, коллеги!
Жизнь заставила работать с таким чудом науки и техники как отечественная ПЛИС
По заявлению производителя это полный аналог древней альтеры EPF10K50SQC240
Согласно документации на альтеру, ПЛИС содержит внутри блочную память, так называемый EAB в количестве 10 шт
Очень уж и уже хочеться ее использовать генерируя память из RTL
В качестве синтезатора использую Synplify 2009, крайнюю версию поддерживающее сиё чудо техники
Делаю все по примерам из референс мануал Synplify, но ничего не выходит
Компайлер говорит что нашел блочную память типа RAM, но маппер размазывает все на регистрах
Прошу знающих избавить от страданий, как все же сгенерировать RAM из RTL ?

Код

module ram_test(q, a, d, we, clk);
output reg [7:0] q;
input [7:0] d;
input [6:0] a;
input we, clk;

reg [6:0] read_add=32,read_add_d;
reg [7:0] mem [127:0] /* synthesis syn_ramstyle="block_ram" */;

always @(posedge clk) read_add_d <= read_add;

always @(posedge clk) begin
    if(we)
        //Register RAM data and read address
        mem[read_add_d] <= d;
        read_add <= a;
    end
    
always @(posedge clk) q <= mem[read_add_d];

----------------------------------------------------------------------------------
@N: MF135 :"e:\bram_test\frontend\rtl\components\bram\sdp_ram_rtl.sv":12:0:12:5|Found RAM, 'mem[7:0]', 128 words by 8 bits
@W:"e:\bram_test\frontend\rtl\components\bram\sdp_ram_rtl.sv":12:0:12:5|Ram mem[7:0] will be mapped into logic and will consume around 1024 register resources.

----------------------------------------------------------------------------------
Total LUTs:  1904 of 2880 (66%)
Logic resources:  1904 LCs of 2880 (66%)
Number of Nets:   1939
Number of Inputs: 8464
Register bits:    1048 (1024 using enable)
EABs:             0  (0% of 10)
I/O cells:       25

[iosifk]

Приветствую, коллеги!
Жизнь заставила работать с таким чудом науки и техники как отечественная ПЛИС
По заявлению производителя это полный аналог древней альтеры EPF10K50SQC240

http://quartushelp.altera.com/14.1/mergedP...og_file_dir.htm

Ну и часть текста оттуда - где ramstyle:
For example, in the following code, the ramstyle synthesis attribute specifies that the inferred RAM my_ram should be implemented using an M512 memory block:
(* ramstyle = "M512" *) reg [0:7] my_ram[0:63];

Note: You can also embed the ramstyle synthesis attribute in a comment following the Variable Declaration of an inferred RAM, as shown in the following code:
reg [0:7] my_ram[0:63] /* synthesis ramstyle = "M512" */;

[addi II]

http://quartushelp.altera.com/14.1/mergedP...og_file_dir.htm

Ну и часть текста оттуда - где ramstyle:
For example, in the following code, the ramstyle synthesis attribute specifies that the inferred RAM my_ram should be implemented using an M512 memory block:
(* ramstyle = "M512" *) reg [0:7] my_ram[0:63];

Note: You can also embed the ramstyle synthesis attribute in a comment following the Variable Declaration of an inferred RAM, as shown in the following code:
reg [0:7] my_ram[0:63] /* synthesis ramstyle = "M512" */;

Спасибо за поддержку!!!
Для Synplify атрибут задается именно как /* synthesis syn_ramstyle="block_ram" */;
Пробовал этот атрибут, а так же altera_use_eab=1 задавать в sdc файле.
В логах пишет, что он нашел sdc и подцепил оба атрибута.
Но в итоге все равно лепит на регистрах...