Максимальная загрузка плис help, Verilog Опции

[iverson]

Добрый день!
Не так давно начал учиться работать с FPGA.
Для работы нужно сделать прошивку чтобы максимально все задействовать (FPGA spartan 6 XC6SLX45 CSG324C), подскажите пожалуйста как такое можно попроще и эффективнее реализовать.

[alexadmin]

В очередной раз пиарю свою поделку для этой задачи: https://opencores.org/project,highload
Можно занять весь объем (+-5%) логики, регистров, памяти и dsp. Трансиверы уж как-нибудь сами