PCIe and FPGA Опции

[polyvyannyy]

Всем привет, уважаемые форумчане!
Возникла необходимость поднять на девборде PCIe 3x8. Референсный дизайн загружен и все работает.
Но теперь нужно сделать прием и отправку своих данных с/на хост. И вот тут то возникла куча вопросов и непониманий. Информации по теории PCIe полно, но никак не удается найти конкретики относительно ПЛИС...какой именно у меня должен быть порядок действий со стороны ПЛИС, чтобы организовать чтение/запись данных в ОЗУ хоста? таблица дискрипторов...кто её формирует, где она хранится?В голове каша и нет четкого понимания.
Прошу помощи у опытных в данной теме людей.
За любые ссылки, проекты, которые можно взять за основу, буду благодарен.

Сообщение отредактировал polyvyannyy - Jun 6 2018, 07:32

[dxp]

Проблема может возникнуть из-за того, что если накидать запросов на чтение - а такой запрос - это простейший TLP, состоящий из заголовка, - так, что в ответ будет валиться большое число комлешнов. По стандарту PCIe реквестер чтения должен заявлять бесконечное число кредитов для ответных комплешнов, поэтому хост будет пытаться честно наливать поток в соответствии с запросами. И если накидать таких запросов (non-posted транзакций), то в ответ повалится неслабая пачка CplD, которая забьёт буфера и всё обломается по таймауту.

Чтобы не доводить до этого, реквестер (ПЛИС) должен метать запросы, контролируя кредиты приёмника. Конечно, можно данные качать порциями - сделал запросы так, чтобы гарантировано не переполнились приёмные буфера, и пока их не вычерпал, новые не слать. Но тогда будет простой на шине и скорости не достичь. Поэтому тут нужно в динамике следить за кредитами и слать запросы так, чтобы и кредитов хватало, и пауз не было. Вот это представляется нетривиальной задачей и её бы хотелось погонять в симуляторе.