Несколько вопросов начинающего по последовательности действий, Вопросы к опытным Опции

[MaxVovk]

Собственно хочется для начала поморгать лапочками . Ну а потом постараться написать кучу 32-битных счетчиков, кучу таймеров с ШИМ, и все это на единой шине с работой через несколько регистров. А если все будет получаться - то и несколько PID, насколько я понимаю, это вполне реально?

В наличии и для отладки - Acex EP1K10.

1. Хочется сразу запаять на плату и развести ноги, которые будут использоваться в проекте. Я правильно понял - все свободные "юзеровские" ноги полностью равноправны и при упаковке я им могу назначить любой вход-выход из проекта?
2. Программировать хочется сразу из управляющего MC. Каким способом проще это делать - эмулировать работу ПЗУшки (сигналы CONF_DONE, STATUS, CLK и DATA) или эмулировать JTAG? Или проще использовать параллельный синхронный, что вроде еще проще?
3. Какой объем нужно предусмотреть в MC для прошивки Acex10-30-50 и на будущее - Cyclone3-6 ? В чем лучше (проще, дешевле) хранить прошивку? И главное - какой файл в проекте (Quartus) есть готовая прошивка и можно ли ее шить по принципу HEX ?
4. Ноги DATA[7:0] в ПЛИСине используются только для загрузки или могут быть использованы в личных корыстных целях?

Был бы благодарен за помощь.

[EvgenyNik]

1. Если все банки IO работают в одном уровне напряжения VCCIO, то да. А если используете разные уровни (3.3, 2.5, 1.8) - то небольшие ограничения по размещению, всё-таки, есть - см. "IO Standarts", "using devices in multiple-voltage systems" в PDF на ПЛИСку.
2. Соглашусь с SM или, как вариант, JTAG. В активном режиме есть риск неуспеть за запросами ПЛИСки. И подумайте - надо ли Вам конфить из МК? ИМХО, специальная загрузочная микруха в общем случае лучше, особенно, если только для этого к МК

придется внешнюю память ставить

Да и пп. 3-4 сразу отпадают.

Сообщение отредактировал Евгений Николаев - Dec 29 2006, 09:41

[MaxVovk]

1. Если все банки IO работают в одном уровне напряжения VCCIO, то да. А если используете разные уровни (3.3, 2.5, 1.8) - то небольшие ограничения по размещению, всё-таки, есть - см. "IO Standarts", "using devices in multiple-voltage systems" в PDF на ПЛИСку.
2. Соглашусь с SM или, как вариант, JTAG. В активном режиме есть риск неуспеть за запросами ПЛИСки. И подумайте - надо ли Вам конфить из МК? ИМХО, специальная загрузочная микруха в общем случае лучше, особенно, если только для этого к МК

придется внешнюю память ставить

Да и пп. 3-4 сразу отпадают.

Спасибо за ответы, не бросайте меня пожалуйста в беде...

Дело в том, что как раз задумано использование огромного "+" FPGA - смена прошивки при изменении конфигурации системы. Так что придется повесить внешнюю флешку. Наверняка есть какие-нибудь со SPI интерфейсом. И сходу новые вопросы:
0. При внешней загрузке (пассивной?) есть ограничения по скорости подачи данных?
1. Активный режим - это когда ПЛИСина грузит себя сама?
2. Сгенерил .rbf файл, он размером 19Кб для Acex10 и 94Кб для Cyclone6... Его размер что, постоянный, не зависящий от проекта..?
3. В Acex нет PLL, т.е. мне нужно затактировать ее снаружи. А чем это делают?

Сообщение отредактировал MaxVovk - Dec 29 2006, 11:18