Не получается использовать PLL на FPGA Altera Опции

[AASsab]

Пытаюсь использовать для умножения клока 50MHz -> 100Mhz Pll FPGA Altera EP2C5... Для этого ипользую мегафункцию ALTPLL. В WIZARD-е выставляю один вход (inclk0) и один выход (c0). Дополнительные сигналы все отключаю. Вроде получается самый простой умножитель на два. В результате всё компилируется без ошибок, но в симуляторе на выходе с0 получаем ХХХХХ, то есть неопределенность. Что я делаю не так? Подскажите что-нибудь или кинте ссылку где об этом подробно описанно. Сам искал, но везде о PLL нописано только в общих чертах и ничего конкретного. Программирую на VHDL.

[AASsab]

Надо подать в тестовом векторе 50МГц а не как сейчас.

Ну подаётся сейчас на вход 12.5 МГц, но я думаю это роли не играет. PLL же просто должен умножать частоту на 2. А он что-то не хочет этого делать даже когда на вход я подал 50МГц. Что же ему ещё надо?