Здравствуйте.
Задача быстро оцифровать аналоговый сигнал длительностью 100-200мкс с частотой 40МГц, потом его неторопливо обработать и вывести на экран. В прикрепленном фаиле приведена структурная схема. Данные с АЦП по параллельному интерфейсу поступают в FIFO. Тактирование АЦП и FIFO осуществляется от одного генератора (40МГц), причем на FIFO тактовый сигнал от генератора приходит в инверсном виде. Это осуществляется для выборки на АЦП и запись в FIFO. После того как сигнал обработан (FIFO заполнено), микроконтроллером неторопливо считываем данные из FIFO и выводин на экран.Вопрос такой - возможно ли по данной структурной схеме все это реализовать. Может кто подскажет ошибки или нюансы которые я неучел. Хотелось бы выявить недостатки на раннем этапе. Жду ответа.
Полная версия этой страницы: АЦП+FIFO+DSPIC помогите советом.
Форум разработчиков электроники ELECTRONIX.ru > Аналоговая и цифровая техника, прикладная электроника > Цифровые схемы, высокоскоростные ЦС
Цитата(Oleg Victorovich @ Feb 3 2009, 18:00) 
Здравствуйте.
Задача быстро оцифровать аналоговый сигнал длительностью 100-200мкс с частотой 40МГц, потом его неторопливо обработать и вывести на экран. В прикрепленном фаиле приведена структурная схема. Данные с АЦП по параллельному интерфейсу поступают в FIFO. Тактирование АЦП и FIFO осуществляется от одного генератора (40МГц), причем на FIFO тактовый сигнал от генератора приходит в инверсном виде. Это осуществляется для выборки на АЦП и запись в FIFO. После того как сигнал обработан (FIFO заполнено), микроконтроллером неторопливо считываем данные из FIFO и выводин на экран.Вопрос такой - возможно ли по данной структурной схеме все это реализовать. Может кто подскажет ошибки или нюансы которые я неучел. Хотелось бы выявить недостатки на раннем этапе. Жду ответа.
Задача быстро оцифровать аналоговый сигнал длительностью 100-200мкс с частотой 40МГц, потом его неторопливо обработать и вывести на экран. В прикрепленном фаиле приведена структурная схема. Данные с АЦП по параллельному интерфейсу поступают в FIFO. Тактирование АЦП и FIFO осуществляется от одного генератора (40МГц), причем на FIFO тактовый сигнал от генератора приходит в инверсном виде. Это осуществляется для выборки на АЦП и запись в FIFO. После того как сигнал обработан (FIFO заполнено), микроконтроллером неторопливо считываем данные из FIFO и выводин на экран.Вопрос такой - возможно ли по данной структурной схеме все это реализовать. Может кто подскажет ошибки или нюансы которые я неучел. Хотелось бы выявить недостатки на раннем этапе. Жду ответа.
Файл со структурной схемой не прикрепился.
Для просмотра полной версии этой страницы, пожалуйста, пройдите по ссылке.