Совместимость таймингов MAC и PHY Опции

[sharikov]

Развел я плату и что-то взбрело мне в голову перепроверить подключение PHY. На всякий случай проверил тайминги. Выпал в осадок. Выходит что не всякий RMII одинаково полезен.
Имеем KSZ8051RNL и IMX28, KSZ в режиме external 50MHz clock. Выдержки из дш привожу ниже:
8051:

imx28:


Это только мне кажется что на передачу у imx28 слишком короткое время удержания чем требует ksz8051 в режиме внешнего клока ? Можно ли что-то с этим сделать кроме замены PHY на более правильный ?
Сравнил с lan8700. Там с таймингами проблем нет.

[Aprox]

Это только мне кажется что на передачу у imx28 слишком короткое время удержания чем требует ksz8051 в режиме внешнего клока ? Можно ли что-то с этим сделать кроме замены PHY на более правильный ?

Если PHY подключены к FPGA, то можно поиграться ее прошивкой и добиться нужного взаимного расположения во времени CLK и данных Причем, несложно сделать прямо на железе. Это, что касается "не менять PHY.". А если менять, то советую обратить внимание на PHY от Vitesse. В них есть программная (MII) подстройка задержки CLK относительно данных.