реклама на сайте
подробности

 
 
> Вопрос к знатокам, по разводке Xilinx
Evgeny_CD
сообщение Apr 27 2006, 13:52
Сообщение #1


Гуру
******

Группа: СуперМодераторы
Сообщений: 2 065
Регистрация: 11-01-05
Из: Москва
Пользователь №: 1 892



FG400 - BGA 1.0 mm 20x20 pins, максимальная "глубина" стороны пинов от края до "центральной поляны", которая GND/VCC - 8 рядов
http://www.xilinx.com/bvdocs/packages/fg400.pdf

Вопрос: если этот корпус разводить на 8-й слойке, то какие нормы зазор/проводник/поясок/дырка необходимы для такой платы?

FG320 - BGA 1.0 mm 18x18 pins, максимальная "глубина" стороны пинов от края до "центральной поляны", которая GND/VCC - 7 рядов
http://www.xilinx.com/bvdocs/packages/fg320.pdf

Вопрос: можно ли этот камень развести на 6-слойке, и нормы для такого случая?

Просто надо оценить стоимость изготовления опытных плат для обоих вариантов камня и принять решение... FG400 предпочтительнее, но вопрос в том, насколько этот вариант будет дороже...

Пока важен именно опытный вариант (таких плат будет несколько).

Камни - XC3S1600E. Каких-то особых требований по разводке (типа диф. пар) нет.
Go to the top of the page
 
+Quote Post
 
Start new topic
Ответов
Magnum
сообщение Apr 29 2006, 06:22
Сообщение #2


Местный
***

Группа: Свой
Сообщений: 214
Регистрация: 26-05-05
Пользователь №: 5 397



IMHO и по "спокойной" технологии можно развести BGA400 в 6 слоях без особых ухищрений. 2 ряда на слой + GND и Vcc.
Go to the top of the page
 
+Quote Post
Evgeny_CD
сообщение Apr 29 2006, 07:28
Сообщение #3


Гуру
******

Группа: СуперМодераторы
Сообщений: 2 065
Регистрация: 11-01-05
Из: Москва
Пользователь №: 1 892



Цитата(Magnum @ Apr 29 2006, 10:22) *
IMHO и по "спокойной" технологии можно развести BGA400 в 6 слоях без особых ухищрений. 2 ряда на слой + GND и Vcc.
При условии, что между "каналом" VIA и дорогой на внутр. слоях зазаор может быть 0.13. Обычно делатели печатных плат хотят этот зазор не хуже 0.2.
Цитата(Владимир @ Apr 29 2006, 11:09) *
Да насколько я понял у них стоимость одна для этих двух приведенных требований к зазорам.
Технология у них такая. Все идет по высшему требованию.
Видимо, при цене 500...600$/заказ им действительно безразлично - производственная линия, судя по всему, и не такое позволяет делать.
Цитата(Владимир @ Apr 29 2006, 11:09) *
Просто мы привыкли, чем крупнее тем лучше, и еще чтобы достать до любой дорожки и скальпелем прорезать
Да, эти славные времена, похоже, в прошлом biggrin.gif
Go to the top of the page
 
+Quote Post

Сообщений в этой теме
- Evgeny_CD   Вопрос к знатокам   Apr 27 2006, 13:52
- - Владимир   Плата DS31256DK сделана на 6слойке. Правда связей ...   Apr 28 2006, 07:06
- - Жека   Уточни, сколько слоев отводится под сигналы. 6 и 8...   Apr 28 2006, 07:21
- - Zeroom   У Xilinx в документе ug012 есть раздел, посвященны...   Apr 28 2006, 09:24
- - Evgeny_CD   Я действительно не совсем коректно поставил вопрос...   Apr 28 2006, 13:50
- - Владимир   Вчера был на фирме, держал образец в руках там сто...   Apr 28 2006, 14:29
|- - Evgeny_CD   Цитата(Владимир @ Apr 28 2006, 18:29) ......   Apr 28 2006, 17:15
|- - PCB technology   Цитата(Владимир @ Apr 28 2006, 18:29) * н...   Apr 29 2006, 12:29
|- - Evgeny_CD   Цитата(PCB technology @ Apr 29 2006, 16:2...   Apr 29 2006, 18:50
- - Владимир   ЦитатаВопрос в том, какая стратегия экономически в...   Apr 29 2006, 07:09
- - Magnum   На внутрених слоях в пределе получается VIA(0,2)+2...   Apr 29 2006, 07:41
- - Zeroom   Кстати, о VIA. Делал на своих платах переходные от...   May 3 2006, 08:04


Reply to this topicStart new topic
1 чел. читают эту тему (гостей: 1, скрытых пользователей: 0)
Пользователей: 0

 


RSS Текстовая версия Сейчас: 23rd July 2025 - 19:08
Рейтинг@Mail.ru


Страница сгенерированна за 0.01381 секунд с 7
ELECTRONIX ©2004-2016