декодер манчестера, аппаратная реализация на частоту 10-50Mhz Опции

[некуцй]

Доброго времени суток!
Пытаюсь реализовать декодер манчестерского кода. Причем очень специфичные требования.
Цель - фронты входного сигнала должны быть переданы максимально детерминированными задержками, как понимаю с минимальным джиттером (передача irig-b сигнала синхронизации)
наихудший показатель 100ns.
Как понимаю, чтоб выполнить эти условия тактовая частота при кодировании декодировании должна быть не меньше 10Mhz.
Как подобная задача вообще решается? Насколько я понял на приемной стороне нужен PLL , из которого я получу такотовую частоту ну и потом через XOR получу нужный мне результат.
Какова будет помехоустойчивость?
Каким образом защищаться от коротких ложных импульсов?
Как можно догадаться из задаваемых вопросов, опыта работы с PLL я не имел и соотвественно вопрос на какие-нибудь примеры из элементной базы. Нашел CY23EP05, CY2305, но не знаю, то ли это, что мне нужно.

Может для этого есть готовые решения? , цель стоит перегнать irig-b сигнал по оптике через трансиверы формата 1x9 которые не работают на низких частотах (100Hz по факту у irig-B ).
Что то вроде сетевых чипов ip113a но с возможностью передавать "чистые" данные.

Сообщение отредактировал некуцй - Dec 29 2012, 07:24

[blackfin]

Manchester Decoder in 3 CLBs.

[некуцй]

Manchester Decoder in 3 CLBs.

The decoder clock can be asynchronous to the
incoming data, but must be faster than five times the incoming
bit rate (in order to detect the next bit transition),
and slower than 12 times the incoming bit rate (in order to
suppress the between-bit transition). The nominal decode
clock frequency should, therefore, be eight times the incoming
data rate.

Вариант интересный но клок должен быть 200MHz или более а это мне кажется уже слишком.

Сообщение отредактировал некуцй - Dec 29 2012, 10:09