Спецификация AT91RM9200, i need help Опции

[aat_81]

Доброго времени суток радиолюбители. Хотелось бы реализовать AT91RM9200 в FPGA в виде IP core. Ядро в данной микросхеме ARM920T. Не хватает спецификации данного процессора для реализации его, в атмеле просить бусполезно нарисуют кругленкую сумму за лицензию(((может быть у кого нибудь завалялась скиньте если не сложно...плиз!!!

[ASN]

aat_81
Для реализации в FPGA вполне достаточно (IMHO) datasheet на AT91RM9200, описание шины AMBA . Только для полной совместимости потребуется FPGA несколько миллионов вентилей (IMHO) и скорость работы будет раз в 10 меньше, чем у оригинала.
Трудоёмкость разработки такого SOC (без использования фирменных IP core для USB, SPI, I2С, MMU и т.п.) очень высока (измеряется человеко-годами). Да ещё разработать firmware. Плюс к тому – большие проблемы с лицензией на использование (МУЛЬТИКОР видимо не даром используют MIPS). Какой смысл?
Лучше присоединяйтесь к opencores.org и реализуйте свой уникальный модуль !

[klop]

aat_81
Для реализации в FPGA вполне достаточно (IMHO) datasheet на AT91RM9200, описание шины AMBA . Только для полной совместимости потребуется FPGA несколько миллионов вентилей (IMHO) и скорость работы будет раз в 10 меньше, чем у оригинала.

1. Атмеловского документа ЯВНО не достаточно для начала такой работы.
2. АРМовский документ по девятым армам гораздо менее интересный чем по седьмым (информации для написания значительно меньше)
3. Ядро девятого арма (от самого арма) бегает в FPGA (Xilinx 6M) на 20 MHz.

[ASN]

klop
1. Кому как. Речь (как я и предполагал) идёт о функциональном аналоге. Реализовать АЛУ с конвейером, декодер команд с предсказателем, полнофункциональный Cash и MMU в точном соответствии с реализацией аналога вроде как в задании не указывалось.
Для функционального аналога вполне достаточно знать формат команд процессора и описание регистров (IMHO).
3.Yes!:
6M – это FPGA несколько миллионов вентилей (только ядро);
20 MHz – это раз в 10 меньше, чем у оригинала;
100 K$ - это (при зряплате около 1,5 K$/месяц) приблизительно равно 6 человеко-годам (только ядро);
Остаётся самый главный вопрос – зачем такие жертвы, если готовый контроллер стоит в тысячи раз меньше?! Тем более, что у Xilinx есть Microblaze (отлаженный и оптимизированный под его структуру).
aat_81
Чтобы сделать набор CORE надо в первую очередь иметь единый интерфейс входящих в него блоков и полнофункциональный набор тестов. Это само по себе приличное по трудозатратам дело.

[aat_81]

Остаётся самый главный вопрос – зачем такие жертвы, если готовый контроллер стоит в тысячи раз меньше?! Тем более, что у Xilinx есть Microblaze (отлаженный и оптимизированный под его структуру).

А кто говорил что нужно делать для Xilinx???Предпполагается сделать набор CORE чтобы в дальнейшем их можно было объединять в SoC как нам требуется и реализация не обязательно ПЛИС это может быть и ASIC

[vetal]

А кто говорил что нужно делать для Xilinx???Предпполагается сделать набор CORE чтобы в дальнейшем их можно было объединять в SoC как нам требуется и реализация не обязательно ПЛИС это может быть и ASIC

Смотрите на AT91CAP - как раз асик))